Le rendement en production de masse
L’article décrit une organisation d’ingénierie de rendement conçue pour la complexité de la production à haut volume.
Source · IEEE Transactions on Semiconductor Manufacturing, 15 juillet 2024
Simulation de métier
Ingénieur Yield & Défautivité, Fab 300 mm FD-SOI
Huit missions au cœur du ramp de la nouvelle fab conjointe STMicroelectronics × GlobalFoundries à Crolles : traquer les défauts à 0,12 par cm², tenir la métrologie, gérer une excursion de particules un vendredi soir et défendre la courbe de rendement devant le comité de pilotage.
13 heures
Avancé
i
Semi-conducteurs
Ouverte
Profil Recherché
Attiré(e) par l'invisible à hauteur d'euros : vous voulez qu'une carte de défauts devienne une décision de production, pas un poster de salle blanche.
Lecteur de signatures : une couronne de bord à 0,34 défaut/cm² vous raconte la santé réelle d'un ramp.
Calme en excursion : une alarme particules un vendredi soir vous structure — journal horodaté, seuils écrits, lots en attente.
Arbitre chiffré : vos recommandations tiennent en dies perdus, en €/plaquette et en exigences AEC-Q100 — pas en impressions de salle blanche.
Pourquoi cette simulation compte
Construisez une expérience concrète et la confiance pour la suite.
Description
Crolles, Isère. Cinquante ans après le plan Calcul, la France y construit la plus grande fab 300 mm de son histoire : une coentreprise STMicroelectronics × GlobalFoundries de 7,5 milliards d'euros, soutenue par 2,9 milliards d'aide d'État autorisée par Bruxelles, pour produire des puces FD-SOI jusqu'au nœud 18 nm : les technologies de l'automobile, de l'industrie et de l'IoT sécurisé. Mais une fab ne vaut que par son rendement : chaque défaut par centimètre carré détruit des dies, des euros et des délais clients. Entre la première plaquette et la capacité cible de 620 000 plaquettes par an, il y a un métier précis : l'ingénieur yield, celui qui lit les cartes de défauts, arbitre les lots en attente et fait monter la courbe de rendement semaine après semaine. Dans cette simulation, vous rejoignez l'équipe yield & défautivité au moment où le ramp passe son premier jalon de qualification automobile.
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Compétences Développées
Ce que vous maîtriserez
Lecture de cartes de défauts (wafer maps, bin maps) et signatures spatiales : couronne de bord, scratch, cluster
Métrologie de fabrication : CD-SEM, overlay, inspection de défauts bright-field KLA, e-test / WAT
Contrôle avancé des procédés : FDC, APC run-to-run, cartes SPC, gestion des excursions
Analyse de cause racine en salle blanche : Ishikawa, 5 Pourquoi, corrélation défaut / équipement / recette
Économie du rendement : coût par bon die, courbe d'apprentissage, sensibilité D0 × surface de die
Prérequis
Ce que vous devez maîtriser
Bases de physique des semi-conducteurs et de fabrication de plaquettes (FEOL/BEOL, lithographie, gravure, dépôt, CMP)
Notions de statistiques industrielles : cartes de contrôle, capabilité, distributions
Lecture de données de production et raisonnement chiffré sous contrainte
Market signals
Pourquoi cette mission compte maintenant
Signaux de marché vérifiés — sources publiques
La lecture financière de la difficulté
L’article de presse économique raconte les difficultés d’un fondeur européen : c’est le récit que le comité de direction a en tête pendant l’arbitrage.
Source · Les Echos, 5 mai 202513,27 milliards de dollars de revenus en 2024, marge brute de 39,3 %
Les chiffres publiés par l’entreprise
Les résultats annuels donnent le cadre financier dans lequel un investissement de rendement doit se justifier.
Source · STMicroelectronics, 30 janvier 20257,5 Md€
La fab conjointe de Crolles
Projet ST × GlobalFoundries finalisé le 5 juin 2023 : nouvelle fab 300 mm adossée au site de Crolles, technologies FD-SOI jusqu'à 18 nm, capacité de l'ordre de 620 000 plaquettes par an à pleine extension.
Source · STMicroelectronics / GlobalFoundries, communiqué du 5 juin 20232,9 Md€
Aide d'État française
Mesure notifiée à Bruxelles et autorisée par la Commission européenne au printemps 2023 — le plus grand soutien public à une fab jamais accordé en France.
Source · Ministère de l'Économie — communiqué du 5 juin 202343 Md€ · 20 %
Ambition Chips Act
Le Chips Act européen vise 43 Md€ d'investissements publics-privés et 20 % de la production mondiale de puces pour l'UE à horizon 2030 — Crolles est son projet emblématique français.
Source · Commission européenne, European Chips Act (2022-2023)Le rendement est la vraie course
À capacité installée égale, c'est la vitesse de montée en rendement (yield ramp) qui fait la compétitivité d'une fab : chaque point de rendement gagné sur un nœud FD-SOI automobile vaut des dizaines de millions d'euros sur la durée de vie du produit.
Source · BEI × STMicroelectronics, décembre 2025 — autonomie stratégiqueTension sur les profils yield & procédés
La vague de fabs européennes (Crolles, Dresde, Catane) crée une pénurie d'ingénieurs yield, défautivité et process integration : les profils juniors se placent typiquement entre 40 et 52 k€, avec prime de tension sur la métrologie et le contrôle avancé.
Source · APEC — Observatoire de l'emploi cadre, études sectoriellesLa simulation en action
Découvrez comment les situations prennent vie
ST et GlobalFoundries finalisent l'accord pour la fab 300 mm de Crolles (5 juin 2023)
newsroom.st.com
FILE
Communiqué officiel : projet de 7,5 Md€, technologies FD-SOI, capacité et calendrier.
Signature du contrat d'aide de l'État de 2,9 Md€ à la fab ST × GF (5 juin 2023)
presse.economie.gouv.fr
FILE
Communiqué du ministère de l'Économie : montant, jalons et contreparties de l'aide.
Ce que l'aide publique finance à Crolles (franceinfo, juin 2023)
franceinfo.fr
FILE
Le projet vu côté public : emplois, calendrier et enjeu de souveraineté.
La BEI et ST annoncent un accord de 1 Md€ (décembre 2025)
newsroom.st.com
FILE
Financement BEI pour la compétitivité et l'autonomie stratégique européennes.
Les missions du programme
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Aperçu du programme
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Task 1
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Task 8
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Ligne d’arrivée
Aperçu du programme
Crolles, Isère. Cinquante ans après le plan Calcul, la France y construit la plus grande fab 300 mm de son histoire : une coentreprise STMicroelectronics × GlobalFoundries de 7,5 milliards d'euros, soutenue par 2,9 milliards d'aide d'État autorisée par Bruxelles, pour produire des puces FD-SOI jusqu'au nœud 18 nm — les technologies de l'automobile, de l'industrie et de l'IoT sécurisé. Mais une fab ne vaut que par son rendement : chaque défaut par centimètre carré détruit des dies, des euros et des délais clients. Entre la première plaquette et la capacité cible de 620 000 plaquettes par an, il y a un métier précis : l'ingénieur yield, celui qui lit les cartes de défauts, arbitre les lots en attente et fait monter la courbe de rendement semaine après semaine. Dans cette simulation, vous rejoignez l'équipe yield & défautivité au moment où le ramp passe son premier jalon de qualification automobile.
Ce que vous allez vivre
- Diagnostiquer
- Décider
- Exécuter
- Convaincre
Prérequis
- Bases de physique des semi-conducteurs et de fabrication de plaquettes (FEOL/BEOL, lithographie, gravure, dépôt, CMP)
- Notions de statistiques industrielles : cartes de contrôle, capabilité, distributions
- Lecture de données de production et raisonnement chiffré sous contrainte
Ce que disent les pairs
Témoignages de professionnels qui ont vécu des missions équivalentes
4.8 •6 voix d’experts
Story
“Diagnostiquer un edge-ring de défauts, remonter au seasoning de chambre, puis arbitrer une boucle APC sur scanners ASML : la logique de ramp-up qu'on m'a demandée mot pour mot en entretien à Crolles.”
Élise P.
Ingénieure intégration junior — 300 mm
Promotion 2025, Grenoble INP Phelma
Story
“Comprendre ce que AEC-Q100 exige vraiment sur la traçabilité m'a fait changer de posture : en fab automobile, chaque dérive a un coût qualité mesurable et un propriétaire nommé.”
Yanis T.
Technicien de production — reconversion semi-conducteurs
Ex-pharma, 6 ans d'expérience
Story
“Cette simulation reflète exactement mon quotidien : DOE, 8D, coordination inter-modules. J'aurais aimé avoir ça avant mon premier entretien.”
Léa M.
Process Integration Engineer
STMicroelectronics Crolles
Story
“Le niveau de détail process est rare. Les cas d'excursion de yield sont calqués sur des situations réelles que j'ai vécues sur le 22FDX.”
Karim B.
Yield Engineer
GlobalFoundries Dresde
Story
“Parfait pour combler le gap entre la théorie en thèse et la réalité industrielle. Les data tables sont alignées avec les specs IRDS 2025.”
Aïcha R.
Doctorante FD-SOI
CEA-Leti
Story
“Très bien sur l'intégration. J'aurais aimé plus de profondeur sur les overlay budgets et le multi-patterning, mais c'est un excellent point de départ.”
Mathieu D.
Lithography Module Owner
STMicroelectronics
Ce que disent les pairs
Témoignages de professionnels qui ont vécu des missions équivalentes
4.8•6 voix d’experts
Story
“Diagnostiquer un edge-ring de défauts, remonter au seasoning de chambre, puis arbitrer une boucle APC sur scanners ASML : la logique de ramp-up qu'on m'a demandée mot pour mot en entretien à Crolles.”
Élise P.
Ingénieure intégration junior — 300 mm
Promotion 2025, Grenoble INP Phelma
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